Cadence Allegro Skill 入门指南：从零开始掌握 PCB 设计自动化

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Skill 是 Cadence 公司开发的一种脚本语言，专门用于扩展和自动化 Allegro PCB 设计工具的功能。它允许设计师通过编写脚本来自动化重复性任务，提高设计效率。Skill 语言的特点包括：

强大的 API 支持 ：可以直接调用 Allegro 的内置功能，如元件放置、走线、DRC 检查等。
灵活的语法 ：支持面向过程和面向对象的编程范式。
高效的执行 ：脚本直接在 Allegro 环境中运行，无需额外编译。

Skill 在 Allegro 中的应用场景包括：

自动化设计流程（如批量修改元件属性）。
自定义设计规则检查（DRC）。
生成设计报告或日志。

Skill 开发需要安装 Cadence Allegro PCB Designer，推荐使用 17.4 或更高版本。可以通过以下命令检查 Allegro 版本：

println(version())

Allegro 自带的 Skill IDE 是开发脚本的主要工具。配置步骤如下：

打开 Allegro PCB Designer。
在菜单栏选择 Tools > Skill IDE。
在 Skill IDE 中，设置默认脚本保存路径和调试选项。

Skill 支持多种数据类型，包括整数、浮点数、字符串和列表。变量通过 defvar 或 let 声明：

; 定义变量
defvar(myVar 10)
let((x 5) (y "Hello"))

函数通过 procedure 定义，支持参数传递和返回值：

; 定义函数
procedure(addNumbers(a b)
  return(a + b)
)

; 调用函数
println(addNumbers(3 4))

Skill 支持常见的控制结构，如条件判断和循环：

; 条件判断
if(x > 10 then
  println("x is greater than 10")
else
  println("x is less than or equal to 10")
)

; 循环
for(i 1 10
  println(i)
)

以下示例演示如何获取和修改元件属性：

; 获取当前设计中的所有元件
let((components (axlDBGetDesign)->components))

; 遍历元件并修改属性
foreach(component components
  axlSetObjectProperty(component "ROOM" "Power")
)

以下示例演示如何获取网络列表并修改网络属性：

; 获取所有网络
let((nets (axlDBGetDesign)->nets))

; 遍历网络并修改属性
foreach(net nets
  axlSetObjectProperty(net "NET_TYPE" "CLOCK")
)

以下是一个自动化设计检查脚本的示例，用于检查元件是否放置在指定区域内：

; 定义检查函数
procedure(checkComponentPlacement()
  let((components (axlDBGetDesign)->components)
      (violations nil))

  ; 遍历元件
  foreach(component components
    let((location (axlGetXY component))
        (x (car location))
        (y (cadr location)))

    ; 检查是否在指定区域内
    when((or (< x 0) (> x 100) (< y 0) (> y 100))
      violations = cons(component violations)
    )
  )

  ; 输出检查结果
  if(violations then
    println("Violations found:")
    foreach(violation violations
      println(axlGetObjectName violation)
    )
  else
    println("No violations found.")
  )
)

; 调用检查函数
checkComponentPlacement()