Buck电路设计实战指南：从参数计算到PCB布局避坑

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刚接触 Buck 电路设计时，最容易在纹波控制和热损耗估算上栽跟头。以下是两个真实案例：

案例 1 ：某工程师直接用 IC 规格书推荐的 22μH 电感，结果输出纹波高达 300mV（要求 <50mV）。问题出在没根据实际电流计算电感值，导致 ΔI 过大。
案例 2 ：用 0805 封装的 10μF 陶瓷电容作输入滤波，量产时批量烧毁。原因是忽略了电容 RMS 电流计算，实际 4A 的纹波电流远超电容承受能力。

核心公式：

$$
D = \frac{V_{out} + V_D}{V_{in} – V_{sw} + V_D}
$$

$V_D$：二极管压降（肖特基约 0.3V）
$V_{sw}$：MOSFET 导通压降

设计要点 ：

CCM 模式适合大电流场景（电感电流始终 >0）
DCM 模式轻载效率更高，但纹波更大

$$
L = \frac{(V_{in} – V_{out}) \times D}{\Delta I \times f_{sw}}
$$

工程经验 ：

ΔI 通常取 20%-40% 的 $I_{out}$（纹波与效率的平衡）
开关频率 $f_{sw}$ 越高，电感体积越小，但损耗增加

附：[Excel 计算模板下载链接]（含保护公式）

高频环路最小化 ：输入电容→MOSFET→电感→二极管必须紧贴
地平面分割 ：功率地与信号地单点连接
热对称布局 ：避免局部过热导致焊盘开裂（实测案例温差达 15℃）
反馈走线内层 ：防止开关噪声耦合
测试点预留 ：关键波形观测位置

图：优化前后辐射噪声对比（30MHz 处降低 12dB）

现象：输出电压出现 200kHz 自激振荡

原因：输入电容 ESR 过大（选用普通电解电容导致）

解决方案 ：

并联低 ESR 陶瓷电容
补偿网络设计（LTspice 仿真步骤）：

.step param Ccomp 100p 1000p 100p
.tran 0 10ms

# Buck 电路参数计算工具
def calc_buck_components(Vin, Vout, Iout, fsw):
    """
    计算关键元件参数
    :param Vin: 输入电压 (V)
    :param Vout: 输出电压 (V)
    :param Iout: 输出电流 (A)
    :param fsw: 开关频率 (Hz)
    :return: 电感值 (uH), 输出电容 (uF), 输入电容 (uF)
    """
    D = (Vout + 0.3)/(Vin - 0.1 + 0.3)  # 估算占空比
    delta_I = 0.3 * Iout  # 取 30% 纹波
    L = (Vin - Vout) * D / (delta_I * fsw) * 1e6  # 转为 uH
    ...

操作步骤 ：